Prof. Dr.-Ing. Peter Zipf
Publikationen
2017 | Sittel, P., Kumm, M., Möller, K., Hardieck, M., Zipf, P., 2017. High-Level Synthesis for Model-Based Design with Automatic Folding including Combined Common Subcircuits, in: Universität Bremen (Hrsg.), 20. Workshop Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen (MBMV). Shaker Verlag, Herzogenrath, S. 103–113.Möller, K., Kumm, M., Zipf, P., 2013. Reconfigurable FIR filter using distributed arithmetic on FPGAs. Circuits and Systems (ISCAS), 2013 IEEE International Symposium on 2058–2061. https://doi.org/10.1109/ISCAS.2013.6572277 |
2015 | |
2014 | Möller, K., Kumm, M., Barschtipan, B., Zipf, P., 2014. Dynamically Reconfigurable Constant Multiplication on FPGAs, in: Ruf, J., Allmendinger, D., Michel, M. (Hrsg.), Workshop Methoden und Beschreibungssprachen zur Modellierung und Verifikation von Schaltungen und Systemen (MBMV). Cuvillier Verlag, Göttingen, S. 159–169. |
2014 | Kumm, M., Klingbeil, H., Möller, K., Zipf, P., Groß, K., Lens, D., 2014. FPGA Based Tunable Digital Filtering for Closed Loop RF Control in Synchrotrons, in: Große, K. (Hrsg.), Scientific Report 2013. GSI Helmholtzzentrum für Schwerionenforschung, Darmstadt, S. 331–332. |
2014 | Möller, K., Kumm, M., Kleinlein, M., Zipf, P., 2014. Pipelined reconfigurable multiplication with constants on FPGAs, in: IEEE (Hrsg.), Field Programmable Logic and Applications (FPL), 2014 24th International Conference on. IEEE, New York, S. 1–6. https://doi.org/10.1109/FPL.2014.6927466 |
2013 | Möller, K., Kumm, M., Zipf, P., 2013. Dynamically reconfigurable FIR filter architectures with fast reconfiguration, in: IEEE (Hrsg.), 8th International Workshop on Reconfigurable and Communication-Centric Systems-on-Chip (ReCoSoC). IEEE, New York, S. 1–8. https://doi.org/10.1109/ReCoSoC.2013.6581517 |
2013 | Kumm, M., Fanghänel, D., Möller, K., Zipf, P., Meyer-Baese, U., 2013. FIR filter optimization for video processing on FPGAs. EURASIP Journal on Advances in Signal Processing 2013, 111–46. https://doi.org/10.1186/1687-6180-2013-111 |
2013 | Möller, K., Kumm, M., Zipf, P., 2013. Partial LUT size analysis in distributed arithmetic FIR Filters on FPGAs, in: IEEE (Hrsg.), 2013 IEEE International Symposium on Circuits and Systems (ISCAS). IEEE, Beijing, China, S. 2054–2057. https://doi.org/10.1109/ISCAS.2013.6572276 |
2013 | |
2012 | Kunz, M., Kumm, M., Heide, M., Zipf, P., 2012. Area estimation of look-up table based fixed-point computations on the example of a real-time high dynamic range imaging system, in: IEEE (Hrsg.), 22nd International Conference on Field Programmable Logic and Applications (FPL). IEEE, S. 591–594. https://doi.org/10.1109/FPL.2012.6339214 |
Weitere Forschungsaktivitäten
